支持高速率SpaceWire总线DS解码优化方法及系统

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支持高速率SpaceWire总线DS解码优化方法及系统
申请号:CN202411658527
申请日期:2024-11-20
公开号:CN119166575B
公开日期:2025-03-18
类型:发明专利
摘要
本发明提供了一种支持高速率SpaceWire总线DS解码优化方法及系统,包括:同步采样模块、偏斜抖动误差补偿模块、异步缓存模块和DS解码模块;同步采样模块经三次信号锁存,将输入DS信号同步到系统采样时钟,传入偏斜抖动误差补偿模块进行数据采样补偿,判断数据有效标志位后传入DS解码模块和异步缓存模块;异步缓存模块移位缓存,转换存储并标志数据有效长度;DS解码模块解码,进行串行化移位操作,输出数据字、控制字。本发明实现三级同步采样,减少信号的竞争冒险风险;总线高速率,能够实现总线200Mbps~400Mbps的解码功能;对DS信号抖动及偏斜造成的采样误差采样补偿,同时采用优化的DS解码算法,解决因信号的抖动和偏斜等问题造成的解码错误。
技术关键词
SpaceWire总线 抖动误差 解码模块 系统采样时钟 高速率 采样模块 数据字 信号 独立时钟 标志位 系统时钟 双端口 解码功能 解码算法
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