摘要
本发明涉及电路设计技术领域,公开了一种存储器数据实时监测传输方法、电路、系统及电子设备,其中传输方法包括基于输入数据编码生成带有校验纠错位的存储数据写入存储单元阵列,读取目标存储单元阵列中的存储数据,译码获取初步输出数据和校验纠错数据,对初步输出数据进行校验纠错,生成信道数据和纠错状态数据,基于信道数据和纠错状态数据生成CRC校验码,并按照预设时序匹配输出信道数据、纠错状态数据和CRC校验码。通过本发明设计的传输方法可以兼容现有的传输协议实时输出存储器的纠错状态方法,达到实时监控存储器输出数据的正确与否,无须增加硬件管脚,降低了系统的集成成本,有切实意义上的实用价值。
技术关键词
校验纠错
存储单元阵列
传输方法
存储器电路
CRC校验码
生成信道
数据编码
控制模块
接口模块
译码
电路设计技术
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