FPGA码流快速压缩方法及系统

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FPGA码流快速压缩方法及系统
申请号:CN202510228321
申请日期:2025-02-28
公开号:CN119727737B
公开日期:2025-06-24
类型:发明专利
摘要
本发明涉及FPGA码流压缩技术领域,一种FPGA码流快速压缩方法及系统,包括:在目标多层索引结构中遍历行号,识别行号对应的数据块组、特征值组及数据块数量,判断数据块数量是否为预设数量,若为预设数量,则判断是否存在后续单一数据块组集,若存在,则合并数据块组与后续单一数据块组集,得到合并数据块组,若不存在,则将数据块组作为原始数据块组,若不为预设数量,则判断特征值组内是否存在相同的特征值,若存在,则对数据块组进行压缩,得到压缩数据块组,若不存在,则将数据块组作为原始数据块组,对合并数据块组集、压缩数据块组集及原始数据块组集进行码流重组。本发明可解决FPGA码流数据的整体压缩效果不佳、占用计算资源较多的问题。
技术关键词
数据 层级 索引 哈希算法 序列 循环冗余校验 位点 加密 特征值组 压缩系统 模块 字段
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