基于硬件时间补偿建模与最小二乘法的LoRa网络同步方法

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基于硬件时间补偿建模与最小二乘法的LoRa网络同步方法
申请号:CN202511192326
申请日期:2025-08-25
公开号:CN121001165A
公开日期:2025-11-21
类型:发明专利
摘要
本发明属于无线通信技术领域,公开了基于硬件时间补偿建模与最小二乘法的LoRa网络同步方法,包括以下步骤:步骤S1、获取网关和节点消息交互时的双向时间戳数据组;步骤S2、对获取的双向时间戳数据组进行数据预处理;步骤S3、结合硬件处理时延,建立动态仿射时钟模型,实现逻辑时间同步;步骤S4、使用最小二乘参数估计的方法,估计参数与步骤S5、基于OLS得到的估计参数与采用交叉验证的形式进行预测精度的验证。本发明采用上述基于硬件时间补偿建模与最小二乘法的LoRa网络同步方法,有效降低了节点功耗和硬件处理延迟波动,实现了高精度的LoRa网络时间同步。
技术关键词
网络同步方法 网关 时钟模型 节点 消息 时延 LoRa芯片 网络时间同步 硬件定时器 滑动窗口 噪声 延迟参数 无线通信技术 数据验证 预测误差 逻辑
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