一种基于时钟同源设计降低千兆以太网网络丢包率的方法

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一种基于时钟同源设计降低千兆以太网网络丢包率的方法
申请号:CN202411688935
申请日期:2024-11-25
公开号:CN119766376B
公开日期:2025-10-14
类型:发明专利
摘要
本发明涉及一种基于时钟同源设计降低千兆以太网网络丢包率的方法,属于计算机网络领域。本发明通过将E2000D芯片和KD5886芯片以及其他负载设备的时钟输入源设计为同源时钟,大大降低了E2000系列处理器平台与其他终端处理器之间SGMII千兆以太网接口的网络丢包率,大大提高了有效数据的传输速率,同时在固件层及应用层采用了双重规避策略,使得不同处理器平台间的SGMII接口网络通信丢包率降低至0%。本发明采用的设计可实现国产化100%,具有自主可控性和可借鉴性,可适用于E2000系列的全部处理器平台,大大提高其SGMII接口与其他负载之间网络数据通信的稳定性。
技术关键词
芯片 时钟发生器 负载设备 接口 终端处理器 差分时钟 固件 交换模块 网络通信 数据通信 平台 系列 晶体 频率 模式 报文 效能
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