摘要
提供一种存储器装置,其包括被配置为输出第一内部芯片选择信号的芯片选择CS缓冲器、被配置为输出内部时钟信号的命令时钟CK缓冲器、被配置为输出第一内部命令/地址信号的命令/地址CA缓冲器、CA缓冲器控制器,其被配置为基于第一内部芯片选择信号控制CA缓冲器的接通/断开、使第一内部芯片选择信号和第一内部命令/地址信号与内部时钟信号同步,以及延迟与内部时钟信号同步的第二内部芯片选择信号的相位,以及命令解码器,其被配置为解码第二内部芯片选择信号、相位延迟的第三内部芯片选择信号和/或与内部时钟信号同步的第二内部命令/地址信号中的任一个。
技术关键词
时钟信号同步
缓冲器控制器
芯片
存储器装置
命令解码器
模式
周期
脉冲控制器
多路复用器
逻辑
存储装置
电平
时延
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