一种减少芯片配置管脚的方法、装置、存储介质及电子设备

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一种减少芯片配置管脚的方法、装置、存储介质及电子设备
申请号:CN202510152672
申请日期:2025-02-12
公开号:CN119621194B
公开日期:2025-06-03
类型:发明专利
摘要
本发明提供的一种减少芯片配置管脚的方法,基于芯片加载方式将芯片分为主动加载模式以及被动加载模式;对主动加载模式或被动加载模式中的不同加载方式的加载时序进行分析,找出同类加载模式下不同加载方式的加载时序不同点,在上位机生成加载数据流时,在所述加载数据流中对同类加载模式下不同加载方式的加载时序不同点处的对应数据流进行修改;若经修改后同类加载模式下不同加载方式的数据流可以合并为一类数据流,则同类加载模式下不同加载方式可以共用同一模式管脚进行芯片的配置。本发明还提供了一种减少芯片配置管脚的装置、计算机可读存储介质以及电子设备。
技术关键词
管脚 芯片 时序分析模块 模式 格式 可读存储介质 数据 电子设备 关键字 计算机 处理器 存储器 定义 时钟 信号
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