一种根据检查时序路径自动优化反馈的方法

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一种根据检查时序路径自动优化反馈的方法
申请号:CN202511147507
申请日期:2025-08-15
公开号:CN121031487A
公开日期:2025-11-28
类型:发明专利
摘要
本发明公开了一种根据检查时序路径自动优化反馈的方法,所述方法包括以下步骤:布局布线流程完成时自动调用检查时序路径脚本;所述检查时序路径脚本包括:获取时序路径的逻辑深度;拆分所述逻辑深度,得到缓冲器与反相器层级和寄存器传输级RTL层级;基于所述逻辑深度、缓冲器与反相器层级和寄存器传输级RTL层级,定位时序问题来源;基于不同的时序问题分级优化;基于分级优化结果,将优化结果嵌入下一阶段的布局布线流程实现闭环。本发明提供的根据检查时序路径自动优化反馈的方法,通过将逻辑深度拆分为缓冲器与反相器层级和RTL层级,精准定位时序问题来源并自动优化反馈,从而提高时序收敛效率,降低芯片设计复杂度。
技术关键词
缓冲器 层级 反相器 逻辑 设计工具 生成优化建议 静态时序分析 脚本 报告 复杂度 布线 布局 物理 闭环 驱动单元 存储单元 终点 芯片 网络
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