小芯片架构下链路层通信的方法及装置

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小芯片架构下链路层通信的方法及装置
申请号:CN202410844630
申请日期:2024-06-26
公开号:CN118860958A
公开日期:2024-10-29
类型:发明专利
摘要
本申请实施例提供了一种小芯片架构下链路层通信的方法及装置,其中,该方法包括:在发送端的第一主路通信与接收端的第二主路通信进行通信时,发送端确定发生异常并确定异常类型;在异常类型是不可校正异常的情况下,发送端从第一主路通信切换为第一旁路通信,接收端从第二主路通信切换为第二旁路通信;通过第一旁路通信和第二旁路通信进行发送端和接收端之间的通信。通过本申请,解决了相关技术中多芯片系统中发生严重错误导致通信中断的问题,进而达到了提高通信速率和稳定性的效果。
技术关键词
数据处理单元 数据处理模块 接收端 发送端 芯片架构 旁路 校正 时间段 可读存储介质 处理器 芯片系统 指令 存储器 计算机 电子设备 速率
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