摘要
本发明涉及后量子密码学和硬件加速领域,提供了一种基于KEY‑RED模乘算法的内生安全可变点NTT硬件实现方法,包括:首先,设计NTT硬件架构所需的旋转因子存储模块、延时反馈模块、随机延时模块、数据输入模块和控制模块;然后,基于所设计的模块,搭建可变点NTT硬件架构;最后,设置模式和输入数据,经过综合设计、实现设计,以及生成比特流文件之后,将代码烧录到FPGA上。该硬件实现方法通过SDF流水结构以及更加高效的KEY‑RED算法来提高NTT算法的运算效率,利用控制单元以及SDF结构的特性来实现可变点的NTT算法,提高算法实现的灵活性,并利用随机延时单元在任意的SDF结构中加入随机延时来抵抗侧信道攻击,从而提高其硬件实现的安全性。
技术关键词
RED算法
延时模块
数据输入模块
SystemVerilog语言
数据分配器
因子
存储模块
生成比特流
控制模块
流水线结构
抵抗侧信道攻击
数据选择器
后量子密码学
模数
数据存储功能
端口
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