一种防止在版图中GGNMOS误接的检查方法

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一种防止在版图中GGNMOS误接的检查方法
申请号:CN202510158259
申请日期:2025-02-13
公开号:CN119598963B
公开日期:2025-04-15
类型:发明专利
摘要
本发明公开了一种防止在版图中GGNMOS误接的检查方法,涉及集成电路技术领域。步骤包括:编写设计规则检查文件,识别版图中的硅化物阻挡层区域;根据编写的设计规则检查文件分析层次连接,判断硅化物阻挡层区域是否正确地连接到漏极端;通过版图设计验证软件自动检查GGNMOS的连接情况,识别出版图中的误接问题;本发明用于防止GGNMOS在集成电路版图中发生误接,精确识别和验证硅化物阻挡层区域的位置和连接,确保与漏极端的正确电气连接,同时优化连接路径,提高电路设计的准确性,还通过SPICE模型仿真来预测电路性能,并通过图形化结果查看和分析工具直观展示检查结果,从而减少人工检查中的错误,提高设计效率。
技术关键词
SPICE模型 检查方法 设计规则检查文件 节点 硅化物阻挡层 模式匹配算法 拓扑分析算法 集成电路版图 电气 定义 邻居 异常点 集成电路技术 密度 列表 识别电路 数据 队列 仿真环境
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