一种基于动态域分解的存算一体架构模拟器加速方法

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一种基于动态域分解的存算一体架构模拟器加速方法
申请号:CN202510280385
申请日期:2025-03-11
公开号:CN119781993B
公开日期:2025-07-18
类型:发明专利
摘要
本发明公开了一种基于动态域分解的存算一体架构模拟器加速方法,该方法基于动态域分解技术,特别适用于离散事件驱动类型的模拟环境。现有的体系结构模拟器会利用现代多核CPU的优势,通过域分解策略将模拟任务分割为多个相对独立的部分,以实现并行处理。然而,在存算一体架构中,由于计算核心数量庞大且各核心之间存在复杂的连接拓扑,传统的域分解方法难以有效应用,这极大地限制模拟效率。本发明提出的方法解决了上述问题,它利用编译器所提供的映射文件,并通过专门设计的算法对模拟模型实施动态域分解。这种方法能够根据模拟架构在执行不同任务时的具体需求,实时调整和优化域的划分,显著提高了存算一体架构模拟器的工作效率和模拟速度。
技术关键词
模拟器 动态 模拟模型 离散事件驱动 深度神经网络模型 核心 工作量 加速装置 计算机程序产品 指令 数据 处理器 可读存储介质 指标 阵列 队列 功耗
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