摘要
本申请实施例提供了一种处理器和数据预取方法。处理器包括:高速缓存,至少一部分空间被分配用于存储元数据,所述元数据是数据预取中的相关地址对;以及数据预取器,基于所述元数据,将数据从存储器预取到高速缓存中,所述预取器包括:采样器,对高速缓存中的集合采样,以计算高速缓存的不同分配下的数据命中率和元数据命中率;训练表,监控缓存的重填来获取每个访存指令的关键性,并利用访存指令的地址流来识别每个访存指令的重用性;以及分配和写入逻辑,基于数据命中率和元数据命中率确定为元数据分配的高速缓存存储空间,并且将符合关键性和重用性阈值的访存指令中的数据地址作为元数据写入到高速缓存中。
技术关键词
访存指令
地址表项
数据预取方法
替换算法
数据预取器
关键性
计数器
条目
处理器
采样器
数值
序列
存储器
逻辑
周期
比率
时钟
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访存指令
地址映射算法
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