摘要
本发明提供了一种三维堆叠神经网络处理架构,三维堆叠神经网络处理架构包括:处理单元层、可重构互连层、存储层、逻辑控制层和垂直互连通道,逻辑控制层和储存层均集成在芯片顶部,处理单元层在芯片底部,可重构互联层在处理单元层和储存层的中间;处理单元层通过垂直互连通道与位于芯片顶部的存储层直接相连,实现低延迟和高带宽的数据传输,处理单元层根据存储层中的数据动态配置资源池,完成神经网络的运算,可重构互连层通过垂直互连通道与处理单元层和存储层连接,通过设置支持多模式动态切换的处理单元层以及可动态重构互连拓扑的可重构互连层,达到灵活适配多样化神经网络模型,提升计算资源利用率,满足对实时性和准确性要求的效果。
技术关键词
堆叠神经网络
垂直互连通道
处理单元
静态随机存取存储器
重构
模块单元
逻辑
时钟管理模块
胖树拓扑
芯片
阻变存储器
低延迟
动态协作
多模式
高带宽
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