一种具有物理与时序感知的高效多比特寄存器合并方法

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一种具有物理与时序感知的高效多比特寄存器合并方法
申请号:CN202411710027
申请日期:2024-11-27
公开号:CN119623366B
公开日期:2025-10-28
类型:发明专利
摘要
本发明提供了一种具有物理与时序感知的高效多比特寄存器合并方法,通过机器学习的方法进行物理与时序感知预测,在设计流程早期阶段实现将多个单比特寄存器合并为多比特寄存器,从而解决了多比特寄存器合并不彻底、对芯片总体时序影响大的问题,达到了在保证设计总体时序水平接近甚至更优的情况下,多比特寄存器合并更彻底、功耗更节省的效果。
技术关键词
合并方法 路径特征 贪心算法 时序预测模型 生成网表 设计工具 物理 逻辑门 信号 节点 功耗 芯片 阶段 电子
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