一种3DIC光电集成式半导体封装结构及其制备方法

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一种3DIC光电集成式半导体封装结构及其制备方法
申请号:CN202411745343
申请日期:2024-11-29
公开号:CN119581345B
公开日期:2025-10-10
类型:发明专利
摘要
本发明提供一种3DIC光电集成式半导体封装结构的制备方法,通过TSV基底、重新布线层、第一电芯片、第二电芯片、介质层及导电柱,将光芯片模块、3D堆叠芯片及水平存储芯片进行集合封装,其中,光芯片模块与3D堆叠芯片通过第一电芯片连接,3D堆叠芯片与水平存储芯片通过第二电芯片连接,以此实现光集成电路与电集成电路的短距离连接,从而大大减少光电信号的传输距离,缩小封装面积,降低功耗,满足光电芯片的高密度集成封装。
技术关键词
半导体封装结构 堆叠芯片 存储芯片 布线 光芯片 ASIC芯片 光电 大马士革工艺 基底 集成电路 高密度集成封装 导电柱 缩小封装面积 散热层 芯片模块 介质 衬底 逻辑
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